电子说
在数字 IC 设计中,有时候需要从一组输入数据中挑出某一个数据出来,比如,输入有 ** “** A、B、C、D” 四个数据,我们需要在特定的条件和特定的时刻输出特定的数据,如何输出特定的数据就是 ** “选择开关” ** ;又或者,可以理解成多个通道输入映射到 单个通道输出 ;于是, 数据选择器(Data Selector) 或 多路开关(Multiplexer) 的数字逻辑威廉希尔官方网站 就应运而生。
基于 2 选 1 的数据选择器的 Verilog 代码和 RTL 威廉希尔官方网站
module Multiplexer( // MUX
input wire a , // 输入数据信号
input wire b , // 输入数据信号
input wire sel , // 输入控制信号
output result // 输出数据信号_已选择
);
assign result = sel ? a : b;
endmodule
基于 4 选 1 的数据选择器的 Verilog 代码和 RTL 威廉希尔官方网站
module Multiplexer( // MUX
input wire a , // 输入数据信号
input wire b , // 输入数据信号
input wire c , // 输入数据信号
input wire d , // 输入数据信号
input wire [1:0] sel , // 输入控制信号
output reg result // 输出数据信号_已选择
);
always @(sel, a, b, c, d) begin
case (sel)
2'b00: result <= a;
2'b01: result <= b;
2'b10: result <= c;
2'b11: result <= d;
endcase
end
endmodule
代码详解
基于 2 选 1 的数据选择器的设计代码,非常简单明了,主要是输入数据 a 和 b,然后通过 sel 信号来决定输出是 a 还是 b。倘若 sel 拉高 (1) ,那么就输出 ** “a”** ,反之,倘若 sel 拉低 (0) ,那么就输出 ** “b”** 。
基于 4 选 1 的数据选择器的设计是基于 查找表 LUT(Look Up Table) (查找表在 FPGA 中非常重要,软件思维可以理解为 “索引”,它是 FPGA 芯片架构的重要组成部分,合理利用查找表,能够使你的 FPGA 硬件工程达到一定程度的优化设计)的方式实现的一个威廉希尔官方网站 。
数据选择器在实际生活中应用广泛。比如,在实际中对选手进行挑选,比如在歌手舞台对 “啊三” 编号为 “a”,对 “啊四” 编号为 “b”。然后 “sel” 这个选择信号就交给 “裁判”,倘若 “啊三” 唱歌功底胜出,那么就输出 “a”,反之那么就输出 “b”,非常的形象!!!
所以还是那句话,数字威廉希尔官方网站 模块没有哪一个模块是平白无故添加出来的,每一个数字威廉希尔官方网站 的小模块在实际生活中都有着非常重要的应用。所有的复杂的模块,都是由这些小模块构成的。 计算机再强大、AI 再智能,都离不开最基本的威廉希尔官方网站 设计单元。
因此,学好数字威廉希尔官方网站 的基础知识之后,才能翱翔于数字威廉希尔官方网站 的世界中,如果基础知识都学不好的话,那么更复杂的就更不用说了。
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