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TI AM57X FPGA MicroBlaze裸机案例开发
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2023-11-02
此案例来源于：创龙科技
测试板卡为：TI Sitara系列AM5728+ Xilinx Artix-7 FPGA开发板
前 言
本文主要介绍基于FPGA + MicroBlaze裸机案例的使用说明，适用开发环境：Windows 7/10 64bit、Xilinx Vivado 2017.4、Xilinx SDK 2017.4。FPGA + MicroBlaze裸机综合案例分为FPGA程序与MicroBlaze裸机程序两部分。
评估板简介
创龙科技TL5728F-EVM是一款基于TI Sitara系列AM5728（双核ARM Cortex-A15 +浮点双核DSP C66x） + Xilinx Artix-7 FPGA处理器设计的高端异构多核评估板，由核心板与评估底板组成。AM5728与Artix-7在核心板内部通过GPMC、I2C通信总线连接，在评估底板通过PCIe通信总线连接。核心板经过专业的PCB Layout和高低温测试验证，稳定可靠，可满足各种工业应用环境。
评估板接口资源丰富，引出双路千兆网口、双路SFP光口、USB 3.0、CAN、RS485、SATA、HDMI、GPMC、FMC等接口，方便用户快速进行产品方案评估与技术预研。
目 录
前 言———— 4
1 mig_dma案例 ————6
1.1 案例功能———— 6
1.2 操作说明 ————6
1.3 关键代码(MicroBlaze)———— 7
1.4 Vivado工程说明 ————16
1.5 IP核配置 ————18
1.5.1 MicroBlaze IP核 ————18
1.5.2 AXI DMA IP核 ————21
1.5.3 MIG 7 Series IP核 ————22
1.5.4 AXI BRAM Controller IP核 ————30
1.5.5 Block Memory Generator IP核 ————32
1.5.6 AXI Timer IP核 ————33
1.5.7 AXI GPIO IP核 ————34
2 aurora_dma案例———— 36
2.1 案例功能 ————36
2.2 操作说明———— 37
2.3 关键代码(MicroBlaze)———— 38
2.4 Vivado工程说明————42
2.5 模块/IP核配置 ————44
2.5.1 MicroBlaze IP核———— 44
2.5.2 AXI DMA IP核 ————44
2.5.3 AXI BRAM Controller IP核————46
2.5.4 Block Memory Generator IP核 ————47
2.5.5 AXI Timer IP核————48
2.5.6 Aurora 8B10B IP核———49
2.5.7 aurora_reset模块————52
2.5.8 cdcm61002_cfg模块———— 4
3 udp_echo案例————57
3.1 案例功能————57
3.2 操作说明————58
3.3 关键代码(MicroBlaze)————61
3.4 Vivado工程说明————63
3.5 模块/IP核配置————65
3.5.1 MicroBlaze IP核————65
3.5.2 AXI Ethernet IP核————65
3.5.3 udp_ip_stack模块————67
3.5.4 udp_echo_server模块————70
3.5.5 cdcm61002_cfg模块————74
4 udp_dma案例————76
4.1 案例功能————76
4.2 操作说明————77
4.3 关键代码(MicroBlaze)————78
4.4 Vivado工程说明————83
4.5 模块/IP核配置————85
4.5.1 MicroBlaze IP核————85
4.5.2 AXI Ethernet IP核————85
4.5.3 udp_ip_stack模块————87
4.5.4 cdcm61002_cfg模块————91
4.5.5 AXI Timer IP核————94
4.5.6 AXI DMA IP核————95
更多帮助————97
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