此外,该新型套件还提供了基于时序的高级设计保存功能、为即插即用设计提供符合 AMBA 4 AXI4 规范的IP支持,同时具备第四代部分重配置功能的直观设计流程,可降低多种高性能应用的系统成本。
在为所有 Xilinx Virtex-6 和 Spartan-6 FPGA 产品系列提供全面生产支持的同时,ISE 12 版本作为业界唯一一款领域专用设计套件,不断发展和演进,可以为逻辑、数字信号处理 (DSP)、嵌入式处理以及系统级设计提供互操作性设计流程和工具配置。此外,赛灵思还在ISE 12套件中采用了大量软件基础架构,并改进了设计方法,从而不仅可缩短运行时间,提高系统集成度,而且还能在最新一代器件产品系列和目标设计平台上扩展 IP 互操作性。
赛灵思 ISE 设计套件高级市场营销总监 Tom Feist 指出:“赛灵思FPGA 为各种应用和市场领域成千上万的设计人员提供创新平台。设计人员在他们的新一代产品中继续不断地采用赛灵思的 FPGA,因为借助我们的产品,他们能在缩减系统成本、降低功耗以及提高性能等要求方面实现最佳平衡。ISE 12设计套件专门为满足设计者的上述目标进行了优化,包括通过功耗和成本方面的软件创新,最大限度地发挥 Virtex-6 与 Spartan-6 器件及平台的功能,并且显著提高了整体设计生产力。”
智能自动化实现功率优化
ISE 12设计套件推出了FPGA 业界首款带自动化分析与精细粒度(逻辑切片)优化功能的智能时钟门控技术。该功能专为减少转换次数而开发,而转换次数正是降低数字设计动态功耗的主要因素。上述技术的工作原理是,利用一系列独特的算法来分析设计方案,以检测每个 FPGA 逻辑切片中转换时不改变下游逻辑和互联的顺序元件(即“转换”)。该软件生成的时钟启用逻辑会自动关闭逻辑切片级不必要的活动,避免关闭整个时钟网络,这样可以节省大量的功耗。
生产力更高,性能更强
ISE 12 设计套件的高级设计保存功能使设计人员能够通过可重复使用的时序结果快速实现设计时序收敛。设计人员不仅能将设计方案进行分区,集中精力满足关键模块所需的时序功能,而且还可在进行其他部分的设计工作时将这些模块锁定,以保存其布局布线。为推出即插即用型 FPGA 设计,赛灵思正对开放式 ABMA 4 AXI4 互联协议上的 IP 接口进行标准化,这既简化了赛灵思及第三方供应商提供的 IP集成工作,同时最大限度地提高了系统性能。为了高效映射于 FPGA 架构,赛灵思还与 ARM 公司共同定义了AXI4、AXI4-Lite 和 AXI4-Stream 规范。
此外,该新型套件还提供了基于时序的高级设计保存功能、为即插即用设计提供符合 AMBA 4 AXI4 规范的IP支持,同时具备第四代部分重配置功能的直观设计流程,可降低多种高性能应用的系统成本。
在为所有 Xilinx Virtex-6 和 Spartan-6 FPGA 产品系列提供全面生产支持的同时,ISE 12 版本作为业界唯一一款领域专用设计套件,不断发展和演进,可以为逻辑、数字信号处理 (DSP)、嵌入式处理以及系统级设计提供互操作性设计流程和工具配置。此外,赛灵思还在ISE 12套件中采用了大量软件基础架构,并改进了设计方法,从而不仅可缩短运行时间,提高系统集成度,而且还能在最新一代器件产品系列和目标设计平台上扩展 IP 互操作性。
赛灵思 ISE 设计套件高级市场营销总监 Tom Feist 指出:“赛灵思FPGA 为各种应用和市场领域成千上万的设计人员提供创新平台。设计人员在他们的新一代产品中继续不断地采用赛灵思的 FPGA,因为借助我们的产品,他们能在缩减系统成本、降低功耗以及提高性能等要求方面实现最佳平衡。ISE 12设计套件专门为满足设计者的上述目标进行了优化,包括通过功耗和成本方面的软件创新,最大限度地发挥 Virtex-6 与 Spartan-6 器件及平台的功能,并且显著提高了整体设计生产力。”
智能自动化实现功率优化
ISE 12设计套件推出了FPGA 业界首款带自动化分析与精细粒度(逻辑切片)优化功能的智能时钟门控技术。该功能专为减少转换次数而开发,而转换次数正是降低数字设计动态功耗的主要因素。上述技术的工作原理是,利用一系列独特的算法来分析设计方案,以检测每个 FPGA 逻辑切片中转换时不改变下游逻辑和互联的顺序元件(即“转换”)。该软件生成的时钟启用逻辑会自动关闭逻辑切片级不必要的活动,避免关闭整个时钟网络,这样可以节省大量的功耗。
生产力更高,性能更强
ISE 12 设计套件的高级设计保存功能使设计人员能够通过可重复使用的时序结果快速实现设计时序收敛。设计人员不仅能将设计方案进行分区,集中精力满足关键模块所需的时序功能,而且还可在进行其他部分的设计工作时将这些模块锁定,以保存其布局布线。为推出即插即用型 FPGA 设计,赛灵思正对开放式 ABMA 4 AXI4 互联协议上的 IP 接口进行标准化,这既简化了赛灵思及第三方供应商提供的 IP集成工作,同时最大限度地提高了系统性能。为了高效映射于 FPGA 架构,赛灵思还与 ARM 公司共同定义了AXI4、AXI4-Lite 和 AXI4-Stream 规范。
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