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fpga与dsp通过emif传输问题
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FPGA
[tr]我现在用
FPGA
生成一组信号,然后通过emif传输给dsp。
开发板
的例程是通过emif收发,我就把dsp端程序的发的部分删掉,然后改fpga部分的程序,但是传输过去的都是同一个数。我的fpga程序是用dds生成正弦信号,然后直接当cs和oe低电平的时候写数据线,可还是不行,望解答,谢谢
[/tr]
回帖
(3)
王金凤
2020-4-7 16:11:00
可以尝试延长DSP的Strobe周期的时间,另FPAG输出数据保持到片选信号无效为止
可以尝试延长DSP的Strobe周期的时间,另FPAG输出数据保持到片选信号无效为止
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李川
2020-4-7 16:20:24
结论如何?
结论如何?
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WwYyZz51
2020-5-18 16:02:58
我最近也是遇到相似问题,楼主解决了吗,能否交流一下?
我最近也是遇到相似问题,楼主解决了吗,能否交流一下?
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