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[问答]

24MHz系统时钟如何产生2MHz时钟

我希望从我的24MHz系统时钟产生2MHz时钟(除以12)。
在Virtex-2库中似乎没有“Divide by 12”部分。
此外,DCM(数字时钟管理器)向导将不允许我从DCM创建除以12的输出,因为我的输入频率非常低。
我没有太多使用DCM的经验,因此只需在DCM向导中输入48MHz的频率即可。
然后,我将被允许生成DCM模块,我可以将我的24MHz时钟连接到我的设计中的输入?
这会导致任何问题吗?
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戴夫

回帖(2)

李咏琪

2020-5-28 07:10:37
关于你可以用这样的东西做的就是尝试看看,但是如果你遇到麻烦,你将无法运行,并且不会得到任何支持。
您是否考虑过生成4 MHz时钟并每隔一个周期选通一次?
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--------------------------不要忘记回复,不要接受作为解决方案-----------
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阮盛婧

2020-5-28 07:26:22
为什么你认为你有问题?数据表的第35页告诉你有一个div。
在FS模式下使用12选项,使用CLKDV作为输出。
时序信息告诉您最小输入频率= 24 MHz,最小输出频率= 1.5 MHz.Peter Alfke
Peter Alfke Xilinx San Jose应用工程总监
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