两片AD7124的SPI接口理论上是可以并联在一起的，但是需要正确地进行片选（Chip Select，CS）信号的管理。在这种情况下，您需要使用两个GPIO引脚分别控制两片AD7124的CS引脚，以确保它们可以独立地进行通信。
根据您的描述，一片芯片的CS引脚已经强制拉高，而另一片芯片读回来全部是0。这可能是由于以下几个原因：
1. **威廉希尔官方网站
设计问题**：确保CS引脚的威廉希尔官方网站
设计正确，没有短路或错误的连接。
2. **电源和地线问题**：检查电源和地线是否正确连接，确保没有噪声或不稳定的电源供应。
3. **SPI通信设置**：检查SPI通信的设置，包括时钟速率、数据位长度、CPOL和CPHA等，确保它们与AD7124的数据手册要求相匹配。
4. **片选信号的控制**：确保在读取数据时，只有一片芯片的CS引脚被拉低，而另一片芯片的CS引脚保持高电平。
5. **软件控制逻辑**：检查控制SPI通信的软件逻辑，确保在切换芯片时，CS信号的控制是正确的。
6. **芯片损坏**：如果以上都检查过了，还是有问题，可能需要考虑芯片是否损坏。
为了进一步诊断问题，您可以尝试以下步骤：
- **使用示波器**：使用示波器检查SPI总线上的信号，确保在正确的时间只有一片芯片的CS信号被拉低。
- **简化测试**：尝试只使用一片芯片进行通信，看是否能够正常工作，这有助于确定问题是否出在硬件上。
- **检查数据手册**：再次仔细阅读AD7124的数据手册，确保所有配置都符合要求。
如果问题仍然存在，可能需要更详细的威廉希尔官方网站
图和软件代码来进行进一步的分析。
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