FPGA|CPLD|ASICwilliam hill官网
登录
直播中
kxbhyl
9年用户
8经验值
擅长:EDA/IC设计
私信
关注
[资料]
小弟新人一枚 求一份32位浮点加法器设计源代码 谢谢各位大哥大姐
二进制
全加器
继电器
加法器
小弟新人一枚 求一份32位浮点加法器设计源代码 谢谢各位大哥大姐
回帖
(10)
kxbhyl
2015-8-26 13:41:38
第一次发帖就沉..
第一次发帖就沉..
举报
dream2018
2015-9-4 19:12:42
你好,我有。标准是IEEE754的。
你好,我有。标准是IEEE754的。
举报
dream2018
2015-9-4 19:24:46
搞什么鬼,回复了还要审核。
搞什么鬼,回复了还要审核。
举报
dream2018
2015-9-5 22:48:35
直接去CSDN 里面收吧。
直接去CSDN 里面收吧。
举报
kxbhyl
2015-9-14 15:25:07
引用:
dream2018 发表于 2015-9-4 19:12
你好,我有。标准是IEEE754的。
32位浮点乘法器设计源代码如果有的话也可以发给我一下吗。QQ邮箱是
281380216@qq.com
引用:
dream2018 发表于 2015-9-4 19:12
你好,我有。标准是IEEE754的。
32位浮点乘法器设计源代码如果有的话也可以发给我一下吗。QQ邮箱是
281380216@qq.com
举报
dream2018
2015-9-14 23:22:17
去CSDN 搜索32位的加减乘除VHDL实现。我已上传了。
去CSDN 搜索32位的加减乘除VHDL实现。我已上传了。
举报
dream2018
2015-9-14 23:23:29
5412525
5412525
举报
zhangziying
2015-9-15 17:31:36
不会啊,共同学习
不会啊,共同学习
举报
h1708587189.2832
2015-9-16 07:24:59
用IP核做倒是挺方便的。。
用IP核做倒是挺方便的。。
举报
joman
2015-11-24 22:25:02
帮你顶一下!!!!共同进步
帮你顶一下!!!!共同进步
举报
更多回帖
rotate(-90deg);
回复
相关帖子
二进制
全加器
继电器
加法器
关于多输入混响hifi录音的,请
各位
大哥大姐
帮忙
2017-03-13
4047
求
一份
数码管时钟的
代码
。。。。刚开始学习单片机,要交作品,望
各位
大哥大姐
帮帮忙
2016-01-01
4848
小弟
新人
一枚
求
一份
32bit
浮点
乘
法器
设计
源代码
谢谢
各位
大哥大姐
2015-09-14
2107
两个4
位
加法器
级联构成
一
个8
位
加法器
verilog怎么写啊?!!
2013-12-03
16725
32
位
浮点
加法器
设计
2013-10-20
3759
请
大哥大姐
们多多照顾,提携
2012-09-28
1106
各位
大哥大姐
,我是
一
个·新手,望前辈们指导
小弟
2012-04-29
1937
各位
大哥大姐
怎么画金手指!!急急急急
2011-12-21
9138
小弟
来报到了 希望
大哥大姐
多多指导
2011-08-25
1549
小弟
来报到了 希望
大哥大姐
多多指导
2011-08-25
1498
发帖
登录/注册
20万+
工程师都在用,
免费
PCB检查工具
无需安装、支持浏览器和手机在线查看、实时共享
查看
点击登录
登录更多精彩功能!
英国威廉希尔公司网站
william hill官网 版块
小组
免费开发板试用
ebook
直播
搜索
登录
×
20
完善资料,
赚取积分