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- Abstract:
- Acquiring the local carrier with the phase locked loop is an important method. In allusion to the limit that the noise performance and the trace speed can’t be optimized at the same time. in this paper the design added adaptive modules to the conventional PLL， which adjusted the parameters according to the current condition. This design simulated the adaptive PLL with MATLAB， and fulfilled the loop in VHDL on the FPGA. When the frequency of the carrier is 10MHz and the sampling frequency is 80MHz， the adaptive PLL designed in this article improves the trace time by about 5 μs when the noise level is low， and decrease the phase dithering by about 0.01 rads.
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