资料介绍
4 位双向移位寄存器(并行存取) 54194/74194
54S194/74S194
54LS194/74LS194
194 为 4 位双向移位寄存器,共有 54194/74194、
54S194/74S194,54LS194/74LS194 三种线路结构形式。
其主要电特性的典型值如下:
型号 fm PD
54194/74194 36MHz 195mW
54S194/74S194 105MHz 425mW
54LS194/74LS194 36MHz 75mW
当清除端(CLEAR)为低电平时,输出端(QA-QD)
均为低电平。
当工作方式控制端(S0、S1)均为高电平时,在时钟
(CLOCK)上升沿作用下,并行数据(A-D)被送入
相应的输出端QA-QD。此时串行数据(DSR、DSL)被禁
止。
当S0 为高电平、S1 为低电平时,在CLOCK上升沿作
用下进行右移操作,数据由DSR送入。
当S0 为低电平、S1 为高电平时,在CLOCK上升沿作
用下进行操作,数据由DSR送入。
当 S0 和 S1 均为低电平时,CLOCK 被禁止。对于 54
(74)194,只有当 CLOCK 为高电平时 S0 和 S1 才可改
变。
逻辑符号:
引出端符号
CLOCK 时钟输入端
CLEAR 清除端(低电平有效)
A-D 并行数据输入端
DSL 左移串行数据输入端
DSR 右移串行数据输入端
S0、S1 工作方式控制端
QA-QD 输出端
极限值
电源电压 7V
输入电压
54/74194,54/74S194 5.5V
54/74LS194 7V
工作环境温度
54××× -55~125℃
74××× -0~70℃
储存温度 -65℃~150℃
54S194/74S194
54LS194/74LS194
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当清除端(CLEAR)为低电平时,输出端(QA-QD)
均为低电平。
当工作方式控制端(S0、S1)均为高电平时,在时钟
(CLOCK)上升沿作用下,并行数据(A-D)被送入
相应的输出端QA-QD。此时串行数据(DSR、DSL)被禁
止。
当S0 为高电平、S1 为低电平时,在CLOCK上升沿作
用下进行右移操作,数据由DSR送入。
当S0 为低电平、S1 为高电平时,在CLOCK上升沿作
用下进行操作,数据由DSR送入。
当 S0 和 S1 均为低电平时,CLOCK 被禁止。对于 54
(74)194,只有当 CLOCK 为高电平时 S0 和 S1 才可改
变。
逻辑符号:
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CLOCK 时钟输入端
CLEAR 清除端(低电平有效)
A-D 并行数据输入端
DSL 左移串行数据输入端
DSR 右移串行数据输入端
S0、S1 工作方式控制端
QA-QD 输出端
极限值
电源电压 7V
输入电压
54/74194,54/74S194 5.5V
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