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何圆

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AD9910 DRG模式产生线性调频信号有两个峰值

自己做了一个威廉希尔官方网站 板,使用FPGA控制AD9910,采用DRG模式产生两段线性调频信号(线性调频信号带宽10M,一段1.5us时宽,一段15us时宽,AD9910后端接有20M带宽带通滤波器);每段线性调频信号经过脉压、加窗处理后发现都有两个峰值,特别是时宽15us的线性调频信号更为明显(详见图1);而且当线性调频信号带宽和时宽变化时,两个峰值相对关系基本固定,都是1.3us左右;DRG模式下各个寄存器参数修改了再修改,但是问题依然存在,请问哪位大虾能帮忙分析一下?

回帖(4)

张蕾

2019-2-26 14:19:52
你好,我也再调,遇到了初相位不固定的问题,求交流,QQ952205578
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李淑嘉

2019-2-26 14:32:15
请问能否给出你的FPGA代码以及AD9910输出的频率随时间变化图,谢谢。上面你发出来的Matlab图是脉压后的频谱图,图中320位置处的杂散信号,与期望信号的距离有多远?能否也说明以下你的脉压方法?
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张蕾

2019-2-26 14:46:18
引用: VERTEX2016 发表于 2019-2-26 16:29
请问能否给出你的FPGA代码以及AD9910输出的频率随时间变化图,谢谢。上面你发出来的Matlab图是脉压后的频谱图,图中320位置处的杂散信号,与期望信号的距离有多远?能否也说明以下你的脉压方法?

请问多片同步,SYNC_OUT没有时钟输出是什么原因呀,单片输出都正常了
reg [39:0] cfr1=40'h0000806200;
reg [39:0] cfr2=40'h0100480800 ;
reg [39:0] cfr3=40'h021f3fc000;
reg [39:0] sync=40'h0a0e000000;
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章先生

2022-11-14 11:37:33
想问下,就是幅度因子调到最大,DDS输出也只有-6dbm左右,满量程输出与芯片手册不一致,RSET是设计的10K欧
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