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赛思电子

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AC1571时钟发生器
一款基于PLL的、适用于5G基站应用的时钟发生器。
采用数字锁相环技术,以实现最佳的高频低相噪性能,具有低功耗和高PSRR能力。

采用ADPLL技术,管脚兼容843N571,可以实现<0.3ps RMS的相位抖动性能。

 

输入频率范围最高2500MHz 

输出抖动优于300fs 

输出时钟频率25M、100M、125M、156.25M和33.333M 

输出3个差分LVPECL电平,7个单独LVCMOS电平