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【作者】:李旺远;王长山;
【来源】:《计算机与现代化》2010年03期 【摘要】:随着芯片集成度的提高,基于片上系统[1](SoC)的片上网络(NoC)已成为芯片设计的重点。随着IP核的增多,节点和链路的故障率大大增加,这就使得运用容错以提高系统的可靠性成为NoC的设计重点。本文在对传统NoC容错技术的基础上,基于2D-Mesh拓扑结构,提出一种基于转弯模型(Turn Model)的跳步容错算法(Hop-Fault-Tolerant,HFT),并在OPNET仿真平台对其进行仿真和性能分析。 【关键词】:片上网络;;容错;;Mesh;;跳步容错 【DOI】:CNKI:SUN:JYXH.0.2010-03-011 【正文快照】:0引言随着半导体工艺技术步入纳米阶段,在单一芯片中集成上亿晶体管已经成为现实,如何有效地利用数目众多的晶体管是芯片体系结构必须回答的新问题。因循单核的发展思路,芯片设计将面临互连延迟、存储带宽、功耗极限等性能提升的瓶颈问题。因此,有必要研究新型的芯片体系架构以 |
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