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基于FPGA的超高速FFT硬件实现
vOzGa7YW.pdf
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介绍了频域抽取基二快速傅里叶运算的基本原理；讨论了基于FPGA达4 096点的大点数超高速FFT硬件系统设计与实现方法，当多组大点数进行FFT运算时，利用FPGA内部大容量存储资源，采用乒乓结构进行流型运算，提高FFT运算速度，同时保证结果的准确性；对实际硬件进行了FFT运算测试，测试结果证明了系统的可行性和正确性，并且利用该硬件系统成功完成了星载SAR实时成像处理。 关 键 词 基二; 快速傅里叶变换; 现场可编程门阵列; 超高速; 大点数 在数字信号处理的发展中，许多算法如相关、滤波、谱估计、卷积等都可以化为离散傅里叶变换(DFT)来实现[1]，因此DFT是处理数字信号如图形、语音及图像等领域的重要变换工具。快速傅里叶变换(FFT)是DFT的快速算法。 FFT算法的硬件实现一般有3种形式：1)使用通用DSP来实现；2)用专用DSP来实现；3)通过FPGA来实现。总体来讲，DSP速度较慢，接口不灵活，而且没有FFT运算所需要的巨量存储器，需外置特定的接口、控制芯片和RAM，限制了运算速度，但DSP开发相对简单，技术成熟，开发费用相对较低，目前大部分FFT硬件是用DSP来实现的；FPGA技术近两年才达到可以实现大点数FFT的水平，并且体积、速度、灵活性等各种性能都优于DSP，但开发难度大，研制费用高。本文将讨论基于FPGA的大点数超高速FFT算法。 
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