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嗨艾琳，
您可以尝试将两个MMCM锁定到同一个时钟区域并检查该工具是否能够放置它们？ MMCM的负载在哪里？ 可能是该工具将MMCM放置得更靠近负载。 谢谢， 迪皮卡。 谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（左边的明星） |
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嗨Irene，从7系列开始，每个时钟区域都有一个CMT（时钟管理磁贴）。
该CMT由PLL，MMCM和移相器组成。在您的情况下，时钟pipe3_clk占用了位于同一时钟区域的MMCM。 因此，第二个clock-ulpi_clk已连接到位于不同时钟区域的MMCM。 预计会有这种行为。 有关详细信息，请参阅UG472的“时钟架构概述”。注意，Krishna -------------------------------------------------- ---------------------------------------------请将帖子标记为 如果提供的信息能够回答您的问题/解决您的问题，请“接受为解决方案”。给予您认为有用的帖子。 |
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只有小组成员才能发言，加入小组>>
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Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办？
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如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区？
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有输入，但是LVDS_25的FPGA内部接收不到数据，为什么？
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请问vc707的电源线是如何连接的，我这边可能出现了缺失元件的情况导致无法供电
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求一块XILINX开发板KC705，VC707，KC105和KCU1500
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