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** Error: ddr3_model_parameters.vh(2968): (vlog-2155) Global declarations are illegal in Verilog 2001 syntax.

3631 FPGA

问答对人有帮助，内容完整，我也想知道答案 0 特权同学 Verilog边码边学 Lesson49 图像采集与显示设计之DDR3缓存模块集成仿真例程中，下载对应例程程序仿真时，modelsim报错： Error: ddr3_model_parameters.vh(2968): (vlog-2155) Global declarations are illegal in Verilog 2001 syntax. # Error: ddr3_model_parameters.vh(3009): (vlog-2730) Undefined variable: 'TDQSCK'. # Error (suppressible): ddr3_model_parameters.vh(3009): (vlog-2388) 'TDQSCK' already declared in this scope (work). # Error: ddr3_model_parameters.vh(3009): Verilog Compiler exiting 上网查资料说可能是路径问题，但是我在sim.do文件中更改 ddr3_model_parameters.vh文件的路径为绝对路径后modelsim仍然报上述错误。请问如何解决？ 0
2020-10-18 12:13:12　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 刘英该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答薄迪该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答 1653344032.827400 该类别下有 12 个回答。邀请回答 2013crazy 该类别下有 11 个回答。邀请回答英雄孤寂该类别下有 11 个回答。邀请回答举报张建磊相关推荐 • 使用modelsim10.1编译xilinx ddr3_model_parameters_c3.vh出问题 10083 • modelsim include报错 2894 • Keil4混编时设置问题 4184 • 用keil编译汇编语言，总是出错，谁帮我看看啊 5431 • keil编译汇编语言，总是出错，谁帮忙看看啊 7761 • *** error 10: Syntax error问题 18315 • 编译显示错误Illegal base specifier in numeric constant. 22579 • modelsim的使用，MIF文件调用，正弦波生成 7205 • 在Quartus ii 13.1中进行波形仿真时出现错误，求大神解答 19815 • quartus13.0和modelisim SE 64 10.1c联合仿真出错 4544 1个回答

答案对人有帮助，有参考价值 0 //------路径问题 1.网上说的“路径问题”，可能是工程目录相对较深，超出编译器处理长度。此种情况建议更改工程路径，例如将其放到根目录。 //------报错信息 2.你这里报错信息是代码中的信号“TDQSCK”未定义。没有说是路径有什么问题。这一点要求查代码。

2020-10-18 14:25:30 评论举报卿小小_9e6