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各位ti工程师，各位大神好！
我在我公司的使用C6455的板卡上遇到这样的问题：我们的板卡架构是PPC+DSP+FPGA。C6455的启动采用PPC通过HPI启动。在启动时遇到这样的问题：板卡上电后，PPC通过HPI加载启动C6455都启动成功，然后我们在调试的过程中需要多次更换FPGA代码，更换C6455代码。这时复位DSP后，PPC重新通过HPI加载启动C6455就会偶尔出现C6455启动没起来的现象。这时PPC端观察到触发C6455启动的HPI中断寄存器标志位也未清零！请问下这是什么原因造成的？ 我们板卡硬件上复位DSP采用的是“Power-on REST”的POR pin引脚，感觉和这复位有关。看资料上还有“Warm Rest”的REST pin引脚复位。请问下该采用这两种的哪一种复位？这两种复位有什么区别？ 
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The boot sequence is started automatically after each power-on reset, warm reset, max reset, and system reset.
POR, warm reset都可以去重新锁存bootmode管脚决定进入哪种boot模式。 看一下POR信号是否足够长？没有和reset管脚接 一起吧？请看下面数据手册上对POR的说明。 7.6.1 Power-on Reset (POR Pin) http://www.ti.com/lit/ds/symlink/tms320c6455.pdf |
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vuywsdfwf 发表于 2020-5-23 03:05 你好！ 经与我们的硬件工程师确认，我们的板卡未改版前你说的两个管脚接一起确实是接一起的，请问接一起会造成该问题吗？什么原因了？ 还有，后来我们的板卡又改了一版，就未接一起了。在改版上的板卡上就未出现该问题！如果真与硬件两个管脚接一起有关？那软件上有没有办法解决啊？谢谢 |
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bei232 发表于 2020-5-23 03:25 按照手册上来，软件没法解决。 To most of the device, reset is de-asserted only when the POR and RESET pins are both de-asserted (driven high). Therefore, in the sequence described above, if the RESET pin is held low past the low period of the POR pin, most of the device will remain in reset. The only exception being that PLL2 is taken out of reset as soon as POR is de-asserted (driven high), regardless of the state of the RESET pin. The RESET pin should not be tied together with the POR pin. http://www.ti.com/lit/ds/symlink/tms320c6455.pdf |
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vuywsdfwf 发表于 2020-5-23 03:33 Shine Zhang 你好！ 那我们出现的该问题确实是两个引脚联一起造成的吗？在你的回复里我想确定是不是该原因！ |
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是两个管脚连在 一起造成的。 The RESET pin should not be tied together with the POR pin. |
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